HDL: Hardware Description Languageには、Verilog HDL, VHDLなどの種類がある。
RTL設計スタイルガイド Verilog HDL編
https://qiita.com/kaizen_nagoya/items/c883b9aab40c53c1d259
改訂がありSystem Verilogにも対応するようになった。
RTL設計スタイルガイド Verilog HDL編(System Verilog対応版)
https://qiita.com/kaizen_nagoya/items/4c02f1575db1f28310a7
プログラマが知っているとよい設計指針(4)STARC RTL 設計スタイルガイド
https://qiita.com/kaizen_nagoya/items/7a3298801259409bd1b9
Xilinx: FPGA と Verilog HDL
https://qiita.com/kaizen_nagoya/items/6db0b65fb1c227722660
FPGAをクラウドで開発する環境を探し中。
https://qiita.com/kaizen_nagoya/items/cdf429ae3d134bae358e
<この項は書きかけです。順次追記します。>
This article is not completed. I will add some words in order.
関連資料
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CPUの創りかた, 渡波 郁
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プログラミング言語教育のXYZ。 仮説(52)
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言語学習母語方式
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設計ってなんですか
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ソースコードは設計である3つの理由。仮説(79)
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ソースコードで議論しよう。日本語で議論するの止めましょう(あるプログラミング技術の議論報告)
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補足資料(Additions)
2023 Countdown Calendar 主催・参加一覧
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CountDownCalendar月間 いいねをいただいた記事群 views 順
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<この記事は個人の過去の経験に基づく個人の感想です。現在所属する組織、業務とは関係がありません。>
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ver. 0.01 初稿 20231218
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